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VBYONE接口高速圖像采集卡.pdf

摘要
申請專利號:

CN201410083509.7

申請日:

2014.03.10

公開號:

CN104917988A

公開日:

2015.09.16

當前法律狀態:

撤回

有效性:

無權

法律詳情: 發明專利申請公布后的視為撤回IPC(主分類):H04N 5/76申請公布日:20150916|||實質審查的生效IPC(主分類):H04N 5/76申請日:20140310|||公開
IPC分類號: H04N5/76; G06F13/28 主分類號: H04N5/76
申請人: 北京阿格思科技有限公司
發明人: 丁善舟; 孫磊; 殷樂生
地址: 100085北京市海淀區上地創業中路32號樓西五層
優先權:
專利代理機構: 代理人:
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法律狀態
申請(專利)號:

CN201410083509.7

授權公告號:

||||||

法律狀態公告日:

2018.07.10|||2015.10.14|||2015.09.16

法律狀態類型:

發明專利申請公布后的視為撤回|||實質審查的生效|||公開

摘要

一種新型V-BY-ONE圖像信號采集轉換裝置,通過對液晶電視生產線上待測板的V-BY-ONE信號實時采集,并轉換成BMP圖像,在讀寫控制模塊的控制下,通過DDR2總線將所述BMP圖像傳至計算機緩存,通過軟件將緩存中的內容讀取出來,用以實現將顯示在液晶屏幕上的V-BY-ONE圖像數據采集并轉換成BMP圖像,實現自動化測控使用。其可廣泛應用于工業液晶電視生產線,通過計算機采集對比圖像,代替傳統手工檢測圖像的檢測工藝,大大提高效率,降低勞動成本。

權利要求書

權利要求書
1.  V-by-One接口高速圖像采集卡,其特征在于:
所述V-BY-ONE信號采集模塊、DDR2SDRAM讀寫控制模塊、數據FIFO、系統控制寄存器、PCIE數據發送引擎、PCIE數據接收引擎和PCIE數據DMA傳輸引擎,所述V-BY-ONE采集模塊的輸入端設置有V-BY-ONE差分信號輸入端口;所述V-BY-ONE差分信號輸入端口連接在所述V-BY-ONE信號接口上;在所述V-BY-ONE信號采集模塊的輸出端設置有一個視頻數據傳輸端口;所述視頻數據傳輸端口連接在DDR2讀寫端口的一端上,在所述DDR2讀寫端口的另一端連接有數據FIFO單元,所述數據FIFO單元的另一端接在PCIE數據發送引擎的輸入端,所述PCIE數據發送引擎的輸出端接在計算機PCIE X4接口上,所述數據FIFO單元在在DDR2SDRAM讀寫控制模塊的控制下,通過所述PCIE數據發送引擎將數據傳輸至計算機PCIE總線上。所述PCIE總線將數據以BMP格式寫入到計算機內存中,所述計算機內存中的BMP圖像被應用程序讀取并處理。

2.  根據權利要求1所述的V-BY-ONE圖像采集裝置,其特征在于:V-BY-ONE采集模塊采用FPGA的SerDes解串模塊。

3.  根據權利要求1所述的V-BY-ONE圖像采集裝置,其特征在于:
1)接口定義為:PCIe4X接口,數據傳輸速率2000MB/s。
2)支持V-BY-ONE格式有:
a JEIDA格式;
b VESA格式。
3)支持V-BY-ONE信號采集數據位深有:
a8Bit(4對數據線);
b10Bit(5對數據線);
4)支持顯示模式有:
a3840*2160,最高支持120Hz幀頻的V-BY-ONE視頻圖像采集;
b1920*1080,最高支持120Hz幀頻的V-BY-ONE視頻圖像采集;
c支持1366*768,幀頻60Hz的V-BY-ONE視頻圖像采集;
d支持3D四通道(四組)道最高120Hz V-BY-ONE視頻圖像的采集;
e支持偏光式3D和快門式3D,并根據3D同步信號將左右眼分開存儲。
5)支持功能有:
a整圖采集測試功能;
b3D幀交錯,行交錯同步測試功能;
c具有場頻(VFQ)測試功能;
d總行數(VTT)測試功能;
e有效行數(VDE)測試功能;
f行總像素數(HTT)測試功能;
g行有效像素(HDE)測試功能。
6)性能指標為:
a在3840*2160、120Hz幀頻下連續采集上傳16幀圖像;
b最高支持3840*2160格式,120Hz幀頻(非3D模式)下連續采集上傳16幀圖像。

說明書

說明書V-by-One接口高速圖像采集卡
技術領域
本發明涉及液晶電視領域中的視頻信號采集技術,具體涉及一種將將液晶電視主板或液晶顯示器主板輸出的V-by-One信號采集并轉換成位圖數據并通過PCIE X4接口將圖像數掘上傳至計算機供分析處理的視頻圖像采集裝置。
背景技術
隨著科技的進步,時代的發展,數字化時代的到來,數字化液晶電視已經普及到千家萬戶,液晶電視的生產量也在這幾年成一種幾何式的爆發式增長。
生產量的提高勢必要求生產廠商不斷擴大生產規模,提高生產效率,增加勞動力投入,尤其近幾年,國內勞動力成本逐年快速增長,這樣也勢必帶來了生產成本的大大增加,而現在市場上的數字液晶電視,品牌繁多,功能豐富,競爭激烈,各個廠商之間都紛紛壓低售價以換取更大市場。售價的降低而生產成本的增長,就帶來了極大的矛盾,因此需要有一種方法能夠提高生產效率,減少勞動力投入,降低生產成本。
此外傳統電視機生產出廠前的檢測采用人工肉眼識別,由于各個員工的責任心,及判別標準都存在很大差異,因此檢測結果存在很大的主觀性和波動性,對于產品質量的標準化形成很大障礙。
因此,急需一種高效可靠的液晶電視自動測試設備,來解決這個矛盾,用以降低勞動成本,提高勞動效率。而液晶電視自動測試設備的關鍵在于,采集V-BY-ONE信號并轉換成圖片信號提供給計算機分析。目前尚未見用以實現將V-BY-ONE采集并轉換成BMP位圖傳輸至計算機的設備。
發明內容
本發明旨在提供一種V-BY-ONE圖像信號采集轉換裝置,用以實現將顯示在液晶屏幕上的V-BY-ONE圖像數據采集并轉換成BMP圖像傳輸至工控計算機,用于實現自動化測控使用。
為了實現上述目的,本發明的基本思路為:將采集到的V-BY-ONE信號,存儲在FIFO中,當存滿一幀時,觸發中斷將數據通過發送引擎發送至計算機PCI總線上。其所采用的技術方案為:
一種用于將液晶電視機芯板上的V-BY-ONE信號接口的圖像信號采集并轉成BMP圖片上傳至計算機的裝置,該圖像采集裝置包括:V-BY-ONE信號采集模塊,所述V-BY-ONE采集模塊的輸入端設置有V-BY-ONE差分信號輸入端口;所述V-BY-ONE差分信號輸入端口連接在所述V-BY-ONE信號接口上;在所述V-BY-ONE信號采集模塊的輸出端設置有一個視頻數據傳輸端口;所述視頻數據傳輸端口連接在DDR2讀寫端口的一端上,在所述DDR2讀寫端口的另一端連接有數據FIFO單元,所述數據FIFO單元的另一端接在PCIE數據發送引擎的輸入端,所述PCIE數據發送引擎的輸出端接在計算機PCIE X4接口上,所述數據FIFO單元在在DDR2SDRAM讀寫控制模塊的控制下,通過所述PCIE數據發送引擎將數據傳輸至計算機PCIE總線上。所述PCIE總線將數據以BMP格式寫入到計算機內存中,所述計算機內存中的BMP圖像被應用程序讀取并處理。
本發明具有如下優點:
1、PCIe4X接口,數據傳輸速率2000MB/s;
2、支持JEIDA、VESA格式,8Bit(4對數據線)、10Bit(5對數據線)數據位深,單組、雙組、四組(最大24對數據線、4對時鐘線)數據格式的V-BY-ONE信號采集;支持3840*2160,最高支持120Hz幀頻的V-BY-ONE視頻圖像采集;支持1366*768,幀頻60Hz的V-BY-ONE視頻圖像采集;
3、支持3D四通道(四組)道最高120Hz V-BY-ONE視頻圖像的采集,支持偏光式3D和快門式3D,并根據3D同步信號將左右眼分開存儲;
具有場頻(VFQ)、總行數(VTT)、有效行數(VDE)、行總像素數(HTT)、行有效像素(HDE)等參數的測試功能;
4、可在3840*2160、120Hz幀頻下連續采集上傳16幀圖像;最高支持3840*2160格式,120Hz 幀頻(非3D模式)下連續采集上傳16幀圖像。
附圖說明
此處所說明的附圖用來提供對本發明的進一步理解,構成本申請的一部分,并不構成對本發明的不但限定,在附圖中:
圖1為本發明的結構圖。
圖2為本發明的參數設置流程圖。
圖3為本發明的數據采集流程圖。
圖4為本發明的數據傳輸流程圖。
具體實施方式
應當理解,此處所描述的具體實施例僅僅用以解釋本發明,并不用于限定本發明。
參見圖1所示,本發明提出的新型V-BY-ONE圖像信號采集轉換裝置,包括V-BY-ONE信號采集模塊、DDR2 SDRAM讀寫控制模塊、數據FIFO、系統控制寄存器、PCIE數據發送引擎、PCIE數據接收引擎和PCIE數據DMA傳輸引擎,V-BY-ONE采集模塊采用FPGA的SerDes解串模塊,將7:1 V-BY-ONE總線的圖像數據轉換為并行數據,保存到DDR2SDRAM中,DDR2 SDRAM讀寫控制模塊分為讀端口和寫端口。寫端口將解串模塊生成的數據進行緩存,寫入到外部DDR2中;讀端口從外部DDR2中讀取數據,供PCIe端口傳輸至計算機內存,數據FIFO用于同步不同速度模塊間的數據傳輸,系統控制寄存器控制各模塊的工作狀態,包括對V-BY-ONE采集模塊的信號格式、啟動停止控制等,對DDR2 SDRAM讀寫控制模塊的讀寫地址、數據長度等,對PCIE數據DMA傳輸引擎的啟動停止控制、被寫入的計算機內存地址的控制等,PCIe數據接收引擎接收來自計算機的控制指令,并按指令要求進行動作,將結果通過PCIe數據發送引擎發送給計算機,PCIE數據DMA傳輸引擎完成大數據量的傳輸,將外部DDR2內存的數據通過DDR2SDRAM讀端口讀出來,通過PCIe總線寫入到計算機的內存。
參見圖2所示,本新型V-BY-ONE圖像信號采集轉換裝置的參數設置流程。在系統非復位狀態且PCIe總線鏈接正常時,接受引擎接收來自計算機的控制指令,并將參數寫入到控制寄存器。
參見圖3所示,描述了本新型V-BY-ONE圖像信號采集轉換裝置的數據采集流程。當系統控制寄存器中的采集啟動位被設置為后采集啟動。系統將采集到的數據存儲的DDR2SDRAM的環形緩沖區中,數據慢一幀后環形緩沖區的地址遞加,數據寫入下一個環形緩沖區,每個環形緩沖區存儲一幀的數據。
參見圖4所示,展示了本新型V-BY-ONE圖像信號采集轉換裝置將數據寫入到計算機內存的流程。數據上傳采用DMA方式進行,很少占用計算機的CPU資源,傳輸速度快。首先計算機進行內存分配,然后將分配到的內存地址寫入采集卡控制寄存器;同時計算機讀取當前緩沖區的地址,計算出需要被讀取的圖像所在的環形緩沖區的地址,并將地址寫入到采集卡的控制寄存器;接著計算機通過向采集卡發控制指令啟動DMA傳輸;采集卡從DDR2SDRAM中讀取數據寫入到計算機的內存中,直至完成。

關 鍵 詞:
VBYONE 接口 高速 圖像 采集
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